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Lehrstuhl für Informatik 3 - D. Fey Vorlesung GRa - SS 2015 4.5.-18.5.2015, Folie 1 Beispiel Cache-Architektur.

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Präsentation zum Thema: "Lehrstuhl für Informatik 3 - D. Fey Vorlesung GRa - SS 2015 4.5.-18.5.2015, Folie 1 Beispiel Cache-Architektur."—  Präsentation transkript:

1 Lehrstuhl für Informatik 3 - D. Fey Vorlesung GRa - SS , Folie 1 Beispiel Cache-Architektur

2 Lehrstuhl für Informatik 3 - D. Fey Vorlesung GRa - SS , Folie 2 Anzahl Einträge im Cache ≙ Anzahl Cache Zeilen = Cache-Größe / Blockgröße 32 * 1024 Byte / 4 Byte = 2 5 * 2 10 / 2 2 = 2 13 Cache-Zeilen → 13 Bits für Adressen notwendig Gegeben  Cache Größe: 32 KByte Blockgröße: 4 Byte Organisationsform: direkt abbildend DatenTag 0x x1FFF...

3 Lehrstuhl für Informatik 3 - D. Fey Vorlesung GRa - SS , Folie 3 Speicher Größe: 1 MByte ≙ 2 20 Byte  Zugriff auf Speicher an der Adresse 0x103450b → 0x00000 Memory... 0x xFFFFF... 0x12 0x42 0x18 0x50

4 Lehrstuhl für Informatik 3 - D. Fey Vorlesung GRa - SS , Folie 4 0x00D1 Welche Cache-Zeile, welches Tag? 4 = 2 2 Byte Blockgröße 2 13 Cachezeilen 0x b TagCache-Zeile 0b Byte-Nr 0x00000 Memory... 0x xFFFFF... DatenTag 0x x1FFF... 0x x x x00D x x12 0x42 0x18 0x50 0x12 0x42 0x18 0x50 {

5 Lehrstuhl für Informatik 3 - D. Fey Vorlesung GRa - SS , Folie 5 Anzahl Einträge im Cache ≙ Anzahl Cache Zeilen = Cache-Größe / Blockgröße / Assoziativitätsgrad (32 * 1024 Byte / 4 Byte) / 2 = 2 5 * 2 10 / 2 3 = 2 12 Cache-Zeilen → 12 Bits für Adressen notwendig Gegeben  Cache Größe: 32 KByte Blockgröße: 4 Byte Organisationsform: jetzt 2-fach assoziativ DatenTag 0x xFFF... 0x001...

6 Lehrstuhl für Informatik 3 - D. Fey Vorlesung GRa - SS , Folie 6 0x0D1 Welche Cache-Zeile, welches Tag? 4 = 2 2 Byte Blockgröße 2 12 Cachezeilen 0x b TagCache-Zeile 0b Byte-Nr 0x00000 Memory... 0x xFFFFF... DatenTag 0x xFFF... 0x x x x0D x x12 0x42 0x18 0x50 0x12 0x42 0x50 { 0x120x420x180x50 0x120x420x180x50 0x In beiden Zeilen ablegbar


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